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tool - (2007/09/11 (火) 20:05:45) の１つ前との変更点
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****tool
-modelsim
--現状の仕様方法
---doファイルで以下のコマンドを実行
----cd /wrkディレクトリ
----vlog *.*(simファイル)
----vsim * work.glbl
----add wave *
----run -all
--macroコマンドで他に使えそうなのはないか？
---⇒?
--compileの仕方で他にオプションはないか？
---error時の動作を設定したい⇒?
--vlog.* fileって？
---compile>compile option>verilog>other verilog options の中身．
---ライブラリ等のdir指定(?)
--glbl.vって？
---xilinxのとき必要(?)
----modelsimで実行時，vsim
--
-visual elite
--デザインを古いverでgenerateしたら、state machineのassign文がごそっと消えた…。⇒saveしなおしたら直ったけど大丈夫か？
--新しいverをいれたら動きがカクカク。最初調子よくてもちょっとするとカクカク。summitに聞いても原因わからず…。とりあえずちゃんと動いてる古いverで。
-Matlab+Simulink
--Simに使えそう
--環境構築，結果評価が楽？
-SimVision
--simtool
--場合によっては、modelsimより使いやすいかも
--既存のlogicを追っていくとき使うブロック図化する機能は、visualeliteやmodelsimよりもはるかに使いやすい。
--が、周りの環境を理解していないため（または、しっかり管理されているため？）お試しで気軽には使いずらい。
****tool
-modelsim
--現状の仕様方法
---doファイルで以下のコマンドを実行
----cd /wrkディレクトリ
----vlog *.*(simファイル)
----vsim * work.glbl
----add wave *
----run -all
--macroコマンドで他に使えそうなのはないか？
---⇒?
--compileの仕方で他にオプションはないか？
---error時の動作を設定したい⇒?
--vlog.* fileって？
---compile>compile option>verilog>other verilog options の中身．
---ライブラリ等のdir指定(?)
--glbl.vって？
---xilinxのとき必要(?)
----modelsimで実行時，vsim
--
-visual elite
--デザインを古いverでgenerateしたら、state machineのassign文がごそっと消えた…。⇒saveしなおしたら直ったけど大丈夫か？
--新しいverをいれたら動きがカクカク。最初調子よくてもちょっとするとカクカク。summitに聞いても原因わからず…。とりあえずちゃんと動いてる古いverで。
-Matlab+Simulink
--Simに使えそう
--環境構築，結果評価が楽？
-SimVision
--simtool
--場合によっては、modelsimより使いやすいかも
--既存のlogicを追っていくとき使うブロック図化する機能は、visualeliteやmodelsimよりもはるかに使いやすい。
--が、周りの環境を理解していないため（または、しっかり管理されているため？）お試しで気軽には使いずらい。
